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浏览/检索结果: 共1条，第1-1条 帮助 已选(0)清除 条数/页：5101520253035404550556065707580859095100   排序方式：请选择作者升序作者降序题名升序题名降序发表日期升序发表日期降序提交时间升序提交时间降序 Multi-valued logic design methodology with double negative differential resistance transistors 期刊论文 MICRO & NANO LETTERS, 2017, 卷号: 12, 期号: 10 作者:  Ji, Yuchao;  Chang, Sheng;  Wang, Hao;  Huang, Qijun;  He, Jin 收藏  |  浏览/下载：2/0  |  提交时间：2019/12/05 logic gates  negative resistance circuits  field effect transistors  adders  multivalued logic design methodology  binary logic  logic density  circuit structure  double negative differential resistance field effect transistor  monostable-multistable transition logic element  MMLE  MVL  ternary logic gates  ternary four-input full adder  function circuits  binary circuit  ternary circuit  information load ability