×
验证码:
换一张
忘记密码?
记住我
CORC
首页
科研机构
检索
知识图谱
申请加入
托管服务
登录
注册
在结果中检索
科研机构
湖南大学 [2]
计算技术研究所 [1]
内容类型
期刊论文 [3]
发表日期
2015 [3]
×
知识图谱
CORC
开始提交
已提交作品
待认领作品
已认领作品
未提交全文
收藏管理
QQ客服
官方微博
反馈留言
浏览/检索结果:
共3条,第1-3条
帮助
已选(
0
)
清除
条数/页:
5
10
15
20
25
30
35
40
45
50
55
60
65
70
75
80
85
90
95
100
排序方式:
请选择
作者升序
作者降序
题名升序
题名降序
发表日期升序
发表日期降序
提交时间升序
提交时间降序
A signal degradation reduction method for memristor ratioed logic (MRL) gates
期刊论文
IEICE ELECTRONICS EXPRESS, 2015, 卷号: 12, 期号: 8, 页码: 6
作者:
Liu, Bosheng l
;
Wang, Ying
;
You, Zhiqiang
;
Han, Yinhe
;
Li, Xiaowei
收藏
  |  
浏览/下载:15/0
  |  
提交时间:2019/12/13
full adder
memristor ratioed logic (MRL) gate
A signal degradation reduction method for memristor ratioed logic (MRL) gates
期刊论文
IEICE Electron. Express, 2015, 卷号: Vol.12 No.0
-
收藏
  |  
浏览/下载:2/0
  |  
提交时间:2019/12/31
full
adder
memristor
ratioed
logic
(MRL)
gate
A signal degradation reduction method for memristor ratioed logic (MRL) gates
期刊论文
IEICE ELECTRONICS EXPRESS, 2015, 卷号: Vol.12 No.8
作者:
Liu, BS
;
Wang, Y
;
You, ZQ
;
Han, YH
;
Li, XW
收藏
  |  
浏览/下载:3/0
  |  
提交时间:2019/12/31
full
adder
memristor
ratioed
logic
(MRL)
gate
©版权所有 ©2017 CSpace - Powered by
CSpace